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Chapter 4 Register Structure and Format 19

Base

Address

+ decimal

Data

Function description R/W

76543210

+2(n) D7D6D5D4D3D2D1D0

D/A output channel n W

+(2(n)+1) D11 D10 D9 D8

Base

Address

+ decimal

Data

Function description R/W

76543210

+0 D7 D6 D5 D4 D3 D2 D1 D0

D/A output channel 0 W

+1 D11 D10 D9 D8

+2 D7 D6 D5 D4 D3 D2 D1 D0

D/A output channel 1 W

+3 D11 D10 D9 D8

+4 D7 D6 D5 D4 D3 D2 D1 D0

D/A output channel 2 W

+5 D11 D10 D9 D8

+6 D7 D6 D5 D4 D3 D2 D1 D0

D/A output channel 3 W

+7 D11 D10 D9 D8

DA3_

U/B

DA3_

5/10

DA2_

U/B

DA2_

5/10

DA1_

U/B

DA1_

5/10

DA0_

U/B

DA0_

5/10

D/A voltage range

and polarity

R/W

Synchronized output

prompt register

+15 SC0

Synchronized output

control bit

R/W

Table 4-1: PCI-1720 register format and function description

* "R" means readable and "W" means writable

4.2.1 D/A Output Channel 0 to 3

The write-only registers of BASE + 2(n) and BASE + (2(n) + 1) accept

data for D/A output channel n (n = 0, 1, 2, 3).

Table 4-2: Register for D/A data

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